CQ出版 トランジスタ技術 2025年7月号 〜 連載中

     「FPGA内部信号が丸見え! モニタ表示回路の製作」

 


関連情報

  ISE 14.7 でFPGA内蔵メモリ (ブロック・メモリ) を使ってフォントROM/信号ラベルROMをIP-ROM化する   ➡︎ 掲載ページ

  ISE 14.7 で DCM (Digital Clock Manager) を使ってVGAクロック生成モジュールIPを用意する         ➡︎ 掲載ページ

  Quartus Prime Lite でFPGA内蔵メモリ (M9K) を使ってフォントROM/信号ラベルROMをIP-ROM化する    ➡︎ 掲載ページ

  Quartus Prime Lite で ALTPLL を使ってVGAクロック生成モジュールIPを用意する              ➡︎ 掲載ページ

  2026年3月号(連載第8回)関連:実験回路用ベース・ファイル・セット(Verilog HDL)            ➡︎ こちら

  2026年4月号(連載第9回),

   2026年5月号(連載第10回)関連:チャタリング除去実験回路用ファイル・セット(Verilog HDL)       ➡︎ こちら

  2026年6月号(連載第11回)関連:7セグメントLEDのダイナミック点灯実験回路用ファイル・セット      ➡︎ こちら



関連ファイル(IP本体およびサポート・ツール)

下のダウンロード・ファイルに収録してある各種ソース・コード類は,一部の制限を除き自由に利用可能です.

詳細は左側の〈関連ファイル利用条件1〉ボタンから確認してください.

こちらの利用条件2とは異なります,

ただし,提供者は一切の責任を負いませんのでご承知の上,ご利用願います.  


FPGA内部信号モニタ表示用IP 表示文字サイズ:ダイナミック可変バーション

  信号をVGAモニタ表示動作中に文字サイズを変更(標準/拡大)することが可能

  本IPは条件付きフリーIPですが,ソースコード(Verilog)フォルダはパスワードで保護

  解凍用パスワードは連載記事中に記載                               ➡︎ ダウンロード・ページ

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FPGA内部信号モニタ表示用IP 表示文字サイズ:固定バーション

  信号をVGAモニタに表示する表示文字サイズは固定(標準/拡大のいずれかを実装前に選択)

  使用するFPGAリソースが若干少ない

  本IPは条件付きフリーIPですが,ソースコード(Verilog)フォルダはパスワードで保護

  解凍用パスワードは連載記事中に記載                               ➡︎ ダウンロード・ページ

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FPGA内部信号モニタ表示用IP関連 サポート・ツール群

  文字フォントおよび信号ラベルをFPGA内部専用メモリを使ってROM化する際の初期化データの生成をサポートするツール群

  AMD (Xilinx) 版用と Altera (intel) 版用を提供

  X64 Windows (11/10) コンソール・アプリ(実行形式)で提供

  本ツールは条件付きフリーですが,フォルダはパスワードで保護

  解凍用パスワードは連載記事中に記載                               ➡︎ ダウンロード・ページ


関連ファイル(IP応用回路例)

下のダウンロード・ファイルに収録してある各種ソース・コード類は,一部の制限を除き自由に利用可能です.詳細は左側の〈関連ファイル利用条件2〉ボタンから確認してください.

こちらの利用条件1とは異なります,

ただし,提供者は一切の責任を負いませんのでご承知の上,ご利用願います. 

ダウンロード・ファイルはzip形式の圧縮ファイルになっており,展開用パスワードは本サイトURL

   www. * .net

の*部になっています.


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「FPGA内部信号モニタ表示用IP」Cmod A7-35Tベース実験回路用ベース・ファイル・セット(2026年3月号・連載第8回関連)

ダウンロード
「FPGA内部信号モニタ表示用IP」Cmod A7-35Tベース実験回路用ベース・ファイル・セット
「FPGA内部信号モニタ表示用IP」を用いたサンプル回路をCmod A7-35Tを利用したブレッド・ボード・ベースの
実験回路上に実装するための基本ファイル・セット
(トラ技連載記事に掲載予定のサンプル回路自体のファイルは別途提供します)
ダウンロード・ファイルはzip形式の圧縮ファイルになっており,展開用パスワードは本サイトURL
   www. * .net
の*部になっています.
Sample_Base.zip
zip ( 圧縮 ) ファイル 179.7 KB

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「FPGA内部信号モニタ表示用IP」チャタリング除去実験回路用ファイル・セット

                 (2026年4月号・連載第9回/2026年5月号・連載第10回 関連

ダウンロード
「FPGA内部信号モニタ表示用IP」チャタリング除去実験回路用ファイル・セット
「FPGA内部信号モニタ表示用IP」を用いたサンプル回路をCmod A7-35Tを利用したブレッド・ボード・ベースの
実験回路上のサンプル回路No.1「チャタリング除去実験回路」関連のファイル・セット
ダウンロード・ファイルはzip形式の圧縮ファイルになっており,展開用パスワードは本サイトURL
   www. * .net
の*部になっています.
Sample1_ChatRemv.zip
zip ( 圧縮 ) ファイル 135.8 KB

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「FPGA内部信号モニタ表示用IP」7セグメントLEDダイナミック点灯実験回路用ファイル・セット

                 (2026年6月号・連載第11回

ダウンロード
「FPGA内部信号モニタ表示用IP」7セグメントLEDダイナミック点灯実験回路用ファイル・セット
「FPGA内部信号モニタ表示用IP」を用いたサンプル回路をCmod A7-35Tを利用したブレッド・ボード・ベースの
実験回路上のサンプル回路No.2「7セグメントLEDダイナミック点灯実験回路」関連のファイル・セット
ダウンロード・ファイルはzip形式の圧縮ファイルになっており,展開用パスワードは本サイトURL
   www. * .net
の*部になっています.
Sample2_7segLED_DLC.zip
zip ( 圧縮 ) ファイル 18.6 KB